音频编解码器 ADAU1861

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技术参数
音频

产品介绍

ADAU1861 是一款具有三个输入和一个输出的编解码器,集成了两个数字信号处理器 (DSP)。从模拟输入到 DSP 内核再到模拟输出的路径经过优化,可实现低延迟。 应用 汽车音响系统 数字音频效果处理器 可编程 FastDSP 音频处理引擎 采样率高达 768 千赫 双模滤波器、限幅器、音量控制、混音 Tensilica HiFi 3z DSP 内核 每个周期四 MAC:24 × 24 位乘法器和 64 位累加器 灵活的功率运行模式:24.576 MHz、49.152 MHz、73.728 MHz 和 98.304 MHz 总内存 336 kB JTAG 调试和跟踪 低延迟、24 位 ADC 和 DAC 106 dB SNR(信号通过带有 A 加权滤波器的 ADC) 110 dB 综合 SNR(信号通过 DAC 和耳机,带 A 加权滤波器) 可编程双精度 MAC 引擎,最大 24 级均衡器 串行端口采样率为 8 kHz 至 768 kHz 5 μs 组延迟(fS = 768 kHz)模拟输入到模拟输出,带 FastDSP 旁路(零指令) 3 路差分或单端模拟输入,可配置为麦克风或线路输入 8 路数字麦克风输入 模拟差分音频输出,可配置为线路输出或耳机驱动器 2 个 PDM 输出通道 PLL 支持 30 kHz 至 36 MHz 的任何输入时钟速率 4 个通道异步采样率转换器(ASRC) 2 个 16 通道串行音频端口,支持 I2S、左对齐、右对齐或高达 TDM16(涡轮增压模式下为 TDM12) 8 个内插器和 8 个衰减器,路由灵活 电源 模拟 AVDD,典型值为 1.8 V 数字 I/O IOVDD,1.1 V 至 1.98 V 数字 DVDD,0.85 V 至 1.21 V 耳机 HPVDD_L,1.2 V 至 AVDD 控制/通信接口

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展厅

该卖家将出席以下展会

Hannover Messe 2024
Hannover Messe 2024

22-26 4月 2024 Hannover (德国) 展会 9 - 展台 G30

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    ACHEMA 2024
    ACHEMA 2024

    10-14 6月 2024 Frankfurt am Main (德国)

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    * 显示价格为参考价,此价格不含税、不含运费、不含关税,也不包含因安装或投入使用所产生的其他额外费用。参考价格可能因国家、原材料价格和汇率的不同而产生变化。